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# iverilog
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> Verilog HDL (IEEE-1364) 코드를 전처리하고 시뮬레이션용 실행 파일로 컴파일 도구.
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> 더 많은 정보: <https://manned.org/iverilog>.
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- 소스 파일을 실행 파일로 컴파일:
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`iverilog {{경로/대상/소스파일.v}} -o {{경로/대상/실행파일}}`
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- 모든 경고를 표시하며 컴파일:
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`iverilog {{경로/대상/소스파일.v}} -Wall -o {{경로/대상/실행파일}}`
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- VVP 런타임을 사용하여 컴파일 및 실행:
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`iverilog -o {{경로/대상/실행파일}} -tvvp {{경로/대상/소스파일.v}}`
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- 다른 경로의 Verilog 라이브러리를 사용하여 컴파일:
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`iverilog {{경로/대상/소스파일.v}} -o {{경로/대상/실행파일}} -I{{경로/대상/라이브러리_디렉터리}}`
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- 컴파일 없이 Verilog 코드 전처리:
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`iverilog -E {{경로/대상/소스파일.v}}`
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